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湯傑策

  • 開發及驗證 Verilog code 
  • 整合使用 FPGA IP,具模擬驗證以達功能的需求
  • Xilinx FPGA Application development C-Coding
  • build the embedded Linux system (Petalinux)
  • 系統驗證項目的規劃及系統整合與測試

Pegatron FPGA Engineer
Taipei,TW

專案經驗


Phased array 

Proof of concept for phase array by Xilinx soc. 

主要工作內容: 
  1. HDL develop and verify.
  2. FPGA IP Integration.
  3. Xilinx FPGA Application development C-Coding 
  4. build the embedded Linux system (Petalinux)
  5. System verification project planning and system integration and testing
開發工具: 
  • c、verilog、vivado、vitis
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EDM控制器

使用MCU、FPGA開發低成本工具機控制器,並且有在全球販售五年以上與進行相關維護。節省控制器成本高達60%。

主要開發內容: 
  1. UART、ADC、FLASH、GPIO應用
  2. motion profile 
  3. PID控制 
  4. FPGA放電系統控制(Like PWM) 
開發工具: 
  • C、verilog、RTOS
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Side Project


主軸顫振無線偵測系統(論文)

使用ADC將顫振信號轉為電壓,透過藍牙發送封包,取得後以FFT分析顫振,並且可從主軸倍頻外的其他頻率進而判定顫振發生。

主要工作內容:

  • 藍芽發送接收軟韌體整合 
  • 接收人機界面開發
  • 傅立葉轉換 
使用工具: 

     github、C、C#

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Memory allocator討論活動

主要目標為火箭控制開發的linux系統找到好的memory allocater,以及Formal Verification相關討論。我負責使用gtest,gcover,memory profile工具建立測試環境,觀察


主要工作內容: 

  • 記憶體效能測試與工具整合
  • 驗證相關工具整合
使用工具: 

Linux、github、makefile、C。


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技能


Develop skill

1. C 

2. Verilog/VHDL 

3. C#/C++ /python


Math

PID Control 

Motion profile

FFT


Platform

Xilinx vivado/Vitis

Linux

8051/STM32/NRF52


經歷

韌體工程師/和碩聯合,2023年 6 月 - 至今 

  • 開發及驗證 Verilog code  
  • 整合使用 FPGA IP,具模擬驗證以達功能的需求
  • Xilinx FPGA Application development C-Coding

EDM RD部門組長/精呈科技,2019年 7 月 - 2023年6月

  • 工作分派與進度追蹤 
  •  單晶片程式設計(C、verilog) 
  •  windows 應用程式開發與維護(C/C++)

中興電機在職碩,2018 年 9 月 - 2021年 8 月 

  • 論文主題:CNC主軸顫振無線偵測系統
  • 指導老師:林俊良

韌體工程師/精呈科技,2016 年 7 月 - 2019年7月 

  • EDM控制器開發(motion profile)
  • 單晶片程式設計(C)
  • Use lattice FPGA develop die sinker machine (verilog) 

軟體工程師/精呈科技,2013 年 6 月 - 2016 年 7 月 

  • 工具機控制器維護(C/C++)

成功大學數學系,2007 年 9 月 - 2012 年 6 月 

  • 主修數學,學習各種數學理論