Physical Design Engineer (Junior/Middle/Senior)

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职缺超过 2 年前更新

职缺描述

具備任何以下技術, 願意接受公司培訓成 APR工程師:

- ASIC RTL Design, ASIC Synthesis,

- VLSI Front End Expertise, VLSI Back End Expertise,

- STA, Physical Verification, Physical Design, Analog Layout,

- Verilog, DFT, ASIC Design Flow

- Primetime/Innovus/ICC1/ICC2/ tool Experience

英文要求: 基本以上

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5
100,000 ~ 200,000 TWD / 月
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职缺

全职
中高阶
2
5万 ~ 8万 TWD / 月
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全职
中高阶
2
6万 ~ 9万 TWD / 月
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全职
中高阶
2
6万 ~ 9万 TWD / 月
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